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基于VerilogHDL的异步串行通信IP核设计
串行通信 VerilogHDL IP 核
2016/9/22
为提高CPU 的工作效率，设计基于VerilogHDL 的异步串行通信IP 核。阐述了异步串行通信的原理、Nios II 嵌入式处理器的系统架构和Avalon 总线特性，分析了异步串行通信的实现方法，给出了各功能模块的接口关系， 并设计完成可供Sopc Builder 直接调用的串行通信IP 核，能正确实现异步串行数据收发功能。实践结果证明：该设 计不但实现了异步串口的正常通信，而且使用方便、通信...